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A arquitetura RISC (Reduced Instruction Set Computer) apresenta um conjunto restrito de instruções, executadas de forma altamente eficiente. Uma das desvantagens desta arquitetura é:

A arquitetura RISC (Reduced Instruction Set Computer) apresenta um conjunto restrito de instruções, executadas de forma altamente eficiente. Uma das desvantagens desta arquitetura é:

  1. A grande necessidade de uso da memória.
  2. A necessidade de conversão de código de alto nível em diversas instruções em Assembly, aumentando o número de instruções a serem executadas.
  3. O aumento do consumo de energia do processador.
  4. O aumento do uso de registradores.
  5. A grande variedade de instruções disponíveis.

Resolução completa

Explicação passo a passo

B
Alternativa B

Alternativa B - A necessidade de conversão de código de alto nível em diversas instruções em Assembly, aumentando o número de instruções a serem executadas.

Análise da Questão

A questão aborda as diferenças fundamentais entre as arquiteturas RISC (Reduced Instruction Set Computer) e CISC (Complex Instruction Set Computer), focando nas desvantagens do modelo RISC.

1. O que é Arquitetura RISC?

O conceito de RISC baseia-se em simplificar o conjunto de instruções do processador.

  • Instruções Simples: Cada instrução realiza uma operação básica (ex: apenas soma ou apenas carga de memória).
  • Execução Rápida: Por serem simples, muitas instruções RISC são executadas em apenas um ciclo de clock.
  • Pipelines Eficientes: A simplicidade facilita o uso de pipelines, aumentando o throughput (instruções por segundo).

2. Qual a Desvantagem Principal?

Como cada instrução é "pobre" (faz pouco trabalho), para realizar uma tarefa complexa (como somar dois números grandes ou manipular arrays), são necessárias mais instruções sequenciais.

  • Comparação com CISC: Em CISC, uma única instrução complexa poderia realizar essa tarefa inteira. Em RISC, podem ser necessárias 5 ou 10 instruções simples.
  • Resultado: Isso aumenta o número total de instruções executadas para completar um mesmo programa.

3. Por que a Alternativa B está correta?

A alternativa B descreve exatamente esse mecanismo:

  • Menciona a conversão de código de alto nível: O compilador precisa traduzir comandos complexos (linguagem C, Java, etc.) em várias instruções simples de Assembly.
  • Menciona o aumento do número de instruções: Esta é a consequência direta do conjunto reduzido. Mais instruções significam mais ciclos de busca na memória (fetch), embora cada execução seja rápida.

4. Análise das demais alternativas

  • (A) A grande necessidade de uso da memória: Embora seja verdade que o código RISC tende a ocupar mais espaço em memória devido ao maior número de instruções (o que chamamos de "expansão de código"), a alternativa B explica a causa raiz desse problema (o aumento do número de instruções). Em questões técnicas, a descrição do comportamento da arquitetura (contagem de instruções) é geralmente preferível à consequência de recursos (memória).
  • (C) O aumento do consumo de energia: Incorreto. O RISC é famoso por ter baixo consumo de energia, pois as instruções são simples e requerem menos circuitos ativos.
  • (D) O aumento do uso de registradores: Característica do RISC, mas não é considerada uma "desvantagem" em si. O uso intensivo de registradores visa evitar acessos lentos à memória, o que é uma vantagem de desempenho.
  • (E) A grande variedade de instruções disponíveis: Incorreto. Isso define a arquitetura CISC. O RISC tem um conjunto restrito (reduzido) de instruções.

Conclusão

A principal troca (trade-off) da arquitetura RISC é: ganha-se velocidade e eficiência de pipeline, mas perde-se densidade de código, exigindo um maior número de instruções para realizar as mesmas operações. Portanto, a alternativa B é a resposta correta.

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